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24AA00/24LC00/24C00
FIGURE 8-2:
RANDOM READ
S
S
MASTER
T
BUS ACTIVITY A
R
Control
Byte
Word
Address(n)
T
A
R
Control
Byte
Data (n)
S
T
O
T
T
P
SDA LINE
BUS ACTIVITY
S 1 0 1 0xxx 0
A
C
K
x xxx
A
C
K
S 1 0 1 0xxx 1
A
C
K
N
O
A
P
x = “don’t care” bit
C
K
FIGURE 8-3:
SEQUENTIAL READ
S
BUS ACTIVITY
MASTER
Control
Byte
Data n
Data n + 1
Data n + 2
Data n + x
T
O
P
SDA LINE
P
A
A
A
A
N
BUS ACTIVITY
C
K
C
K
C
K
C
K
O
A
C
K
? 2007 Microchip Technology Inc.
DS21178G-page 9
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